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Sobre

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Possuo graduação em Engenharia Elétrica pela Universidade Federal do Paraná - UFPR (2011) e Mestrado em Engenharia da Computação da Universidade Ferderal do Rio Grande - FURG (2015), onde também trabalhei como Professor Substituto. Completei o Curso de Formação de Projetistas de Circuitos Integrados Digitais - CI Brasil (2016) e atualmente sou Bolseiro de Investigação no INESC TEC. Tenho experiência na área de Engenharia Elétrica, com ênfase em Eletrônica, atuando principalmente nos seguintes temas: Microeletrônica e Projeto de Circuitos Integrados Digitais.

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Detalhes

Detalhes

  • Nome

    Helder Henrique Avelar
  • Cargo

    Estudante Externo
  • Desde

    10 fevereiro 2017
002
Publicações

2018

Design and Evaluation of a Low Power CGRA Accelerator for Biomedical Signal Processing

Autores
Avelar, HH; Ferreira, JC;

Publicação
21st Euromicro Conference on Digital System Design, DSD 2018, Prague, Czech Republic, August 29-31, 2018

Abstract
This work presents the design and analysis of a biological signal processing accelerator, including an interface controller and memory subsystem for a low-power CGRA. The controller design supports several operation modes, which can perform several applications when paired with the CGRA reconfiguration capabilities. Physical synthesis shows that the controller introduces only a 6 percent area and power overhead compared to the CGRA core, while allowing independent processing of inner loops at high frequencies and the exploitation of pipelining and parallelism. In-depth power analysis based on layout information was performed, including an evaluation of the use of power gating techniques. A practical case study (ECG signal processing) was also evaluated. © 2018 IEEE.

Teses
supervisionadas

2017

Broadcast Cancellation in Unstructured Networks

Autor
Rui Manuel Dias Ferreira Lima

Instituição
UM